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标题: [求助]一个FPGA问题大家讨论下啊 [打印本页]

作者: romanteck 时间: 2006-9-12 10:56 标题: [求助]一个FPGA问题大家讨论下啊

设计了一个程序烧到FPGA里面测试的时候外接AD （AD的采样声中和FPGA是一个晶阵）

测试的时候需要烧IIC,发现在不加激励的时候IIC可以读写但是一加激励（AD输出）就不能读写

了,是什么原因呢大家有这方面的经历吗

我怀疑是外部的时序没满足 FPGA综合的时候没加输入延迟的约束

大家帮我解惑～～

作者: rouder21control 时间: 2006-9-12 11:16

估计是你的AD读写时序不对，虽然仿真的时候可能对，但综合后就不对了。可用示波器检查一下读写AD的时序是否正确。

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