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标题: [求助]DCM的问题 [打印本页]

作者: yellowrivr 时间: 2006-10-27 17:41 标题: [求助]DCM的问题

我用向导生成了一个DCM的模块，可是我用的是VHDL，模块的例子是Verilog，那我怎么例化呢

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