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标题: 求助使用VHDL编辑一个串行接口 [打印本页]

作者: lanfeng 时间: 2004-4-27 20:25 标题: 求助使用VHDL编辑一个串行接口

有10个输入，6个输出，输入状态寄存器ISR,输入数据寄存器IDR,输出状态寄存器OSR输出数据寄存器ODR 。
输入寄存器定义IDR：若ISR未收到数据，则读IDR所得的数就是ISR所指输入端收到的数据。在读之前先读ISR，否者无法确定所的数据是哪一个输入端的。由于每一个输入端只读一次，因此绘造成数据丢失。
输出状态寄存器OSR的定义：
输出状态寄存器OSR的低6位对应6个TXD输出端。某位为1，表示该位对应的输出端的缓冲寄存器是空的可以接收数据，每个TXD输出端有一个缓冲寄存器和一个移位寄存器，缓冲寄存器接收数据，移位寄存器发送。
串口波特率38.4K，输入时钟19.6608M.
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