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标题: [求助]Actel-libero调用ModelSim做布线后仿真 [打印本页]

作者: A120 时间: 2004-7-30 15:23

问题解决了，但是只能用它自带ModelSim仿真，不能用独立的ModelSim se仿真！！！

有人遇到过吗？

作者: boyfly 时间: 2004-8-2 10:15

可以用吧，可以选择的！选择你用哪个仿真，综合工具！

作者: A120 时间: 2004-8-2 12:33

用VHDL就一切正常，可以做后仿真。

用Verilog就只能用Actel自带的仿真。

郁闷！！！
我刚开始用LIBERO，在做布线后仿真和综合后仿真时只能用Actel自带ModelSim仿真，不能用独立的ModelSim se仿真！！！
但前仿真两种ModelSim都可以用！
错误显示：
# ** Error: ** Error: D:/ModelSim/Actel/Vlog/ex/@d@f@c1@b/_primary.dat(6877): near "resetall": expecting: ':'
# ** Error: D:/ModelSim/Actel/Vlog/ex/@d@f@c1@b/_primary.dat(6877): near "resetall": expecting: ':'

有人遇到过吗？是有什么设置吗？

作者: A120 时间: 2004-10-14 15:26 标题: [求助]Actel-libero调用ModelSim做布线后仿真

我用的是LIBERO自带的ModelSim 5.8B，用的Verilog，显示如下：

# Loading D:/Libero/Model/Actel/Vlog/ex.UDP_MUX2
# ** Error: (vsim-SDF-3250) F:/Work/My_Actel/expand/designer/impl1/expand_ba.sdf(0): Failed to find INSTANCE '/expand_0'.
# Error loading design
# Error: Error loading design
# Pausing macro execution
# MACRO ./run.do PAUSED at line 5

刚开始用LIBERO，有人知道是有什么设置吗？

作者: chuangye 时间: 2004-10-14 15:26

我用自带Modelsim 5.8b仿真时,错误是no verilog simulation license.
如何解决此问题?
谢谢!!!

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