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FPGA里各模块字电路用VHDL程序代码连接是怎么编译的?

FPGA里各模块字电路用VHDL程序代码连接是怎么编译的?

各位大侠:
   


    FPGA里各模块用VHDL程序代码连接是怎么编译的?


我是初学者对MAXPLUS2还不是很了解,望高人指点!谢谢!

╰☆Gind☆╮
例如有一个程序包还有两个模块,应如何编译?
╰☆Gind☆╮
再写一个顶层vhdl文件,定义为和工程名字相同的名字,把你编好的那两个模块用元件例化的方式在这个顶层文件里面调用就ok了

看法相同
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