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ZYNQ 片内pin Delay导入Allegro

ZYNQ 片内pin Delay导入Allegro

最近设计一款产品的时候,需要用到zynq7015,在参考picozed的设计的时候,他们的原理图中有这样一句话,如下图所示


明确说DDR设计的时候需要考虑片内延时,当时问过专业layout的朋友,他们告诉我这个一般是别人提供的,你只需要导入就可以了。只导入也简单,可这数据从哪里来,没有人能告诉我,问过安富利的FAE他们也没有告诉我哪里有,于是和朋友讨论这个问题,也在手册里面到处找,最后在UG586中看到这样一段


哈哈,赶紧打开Vivado


在最下面一栏Type a Tcl commond here里面输入link_design -part xc7z015iclg485


然后回车会出现如下界面:


在最下面一行输入write_cvs zynq_pin_delay(这个名字随便起,自己知道就OK)如下图:


回车就会生成相关的文件


需要的文件已生成,路径在上面也给出了,可以直接用Excle打开


如上图所示的部分。我们简单做下编辑。突然发现这里面的数据不能直接用,因为这里面提供的数据首先单位是ps,然后给出了一个最大值和最小值,还有一些无关的东西。需要注意的是通过Allegro pin delay格式。我这里通过导出ZC706的来参考他们的格式:


PIN DELAY
REFDES U1DEVICE SOC_IRONWOOD_FF900


PIN_NAME PIN_DELAY 这里是管脚名和管脚的延时,延时是以mil为单位,那么我们在算的时候,需要根据材质来计算1ps的延时相当于多少mil, 这里需要计算在网上找了下如公式PCB布线延时传播公式.docx


这里我就按6,现在开始始整理生成的文件,提取出我们需要的数据,其他的我们直接删掉就好。
原始格式如下:


我们在Max Trace Delay (ps)后面新建一行,来计算最大小的平均值:



在新的栏里输入=(E6+F6)/2回车就能得到平均值


然后选中单元格,下拉,把剩下的全算出来


ps转为mil这里大概取6倍,再在后面新建一列


再加上单位mil,后面再新建一列。


将算出来的值和MIL合并,在MIL那一列后面再新建一列。
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