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elantra_no1发表于 2008-5-6 14:05 | 只看该作者

FPGA 设计全流程

FPGA, 流程, 设计

FPGA 设计全流程：Modelsim>>Synplify.Pro>>ISE
第一章 Modelsim 编译 Xilinx 库
第二章调用 Xilinx CORE-Generator
第三章使用 Synplify.Pro 综合 HDL 和内核
第四章综合后的项目执行
第五章不同类型结构的仿真

CXtiKJnS.rar (212.87 KB)

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xzhdx发表于 2008-5-12 15:47 | 只看该作者

very good~

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fengfeng2536发表于 2008-5-20 09:23 | 只看该作者

hao!

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supjunior发表于 2008-5-20 23:47 | 只看该作者

学习一下

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soaram发表于 2008-5-21 08:35 | 只看该作者

顶，看看

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soaram发表于 2008-5-21 08:35 | 只看该作者

还不让我看，怎么回事？？

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sky19870613发表于 2008-5-23 16:56 | 只看该作者

谢谢LZ拉

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zzly发表于 2008-5-25 12:15 | 只看该作者

下载来看看谢谢啦哈哈

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yanzhe127发表于 2008-5-26 20:18 | 只看该作者

下载看看谢谢了

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yanzhe127发表于 2008-5-26 20:24 | 只看该作者

还不让我看，怎么回事？？

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justin_liu发表于 2008-5-31 22:46 | 只看该作者

好东西

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sunyuanhua发表于 2008-6-2 12:53 | 只看该作者

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zhanji007发表于 2008-6-10 08:40 | 只看该作者

真是好东西

谢谢楼主的无私奉献，我的EMAIL:zhanji007@126.com,谢谢了

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wafa发表于 2008-6-15 09:59 | 只看该作者

good

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