首页 | 新闻 | 新品 | 文库 | 方案 | 视频 | 下载 | 商城 | 开发板 | 数据中心 | 座谈新版 | 培训 | 工具 | 博客 | 论坛 | 百科 | GEC | 活动 | 主题月 | 电子展

FPGA/CPLD可编程逻辑

[ 26527 主题 / 25683 回复 ]

版块介绍: 讨论关于FPGA和CPLD的相关话题!

版主: boyfly, stone133, flanix, bydxdtcdj, 电子狂热, xcx_hust, benbenfei, AndyLee008

FPGA/CPLD可编程逻辑

    标题 作者 回复/查看 最后发表
common   利用Xilinx的XPS工具写的一个时钟程序--转载 冰封 2015-1-27 0/409 冰封 2015-1-27 21:21
common   个人总结的FPGA学习流程,仅供参考 冰封 2015-1-27 0/527 冰封 2015-1-27 21:20
common   七点入手让你快速掌握FPGA开发 冰封 2015-1-27 0/393 冰封 2015-1-27 21:20
common   如何在赛灵思ISE中修改自己的IP? 冰封 2015-1-27 0/376 冰封 2015-1-27 21:18
common   初学者学习Verilog HDL的步骤和经验技巧 冰封 2015-1-27 0/296 冰封 2015-1-27 21:18
common   FPGA设计中对输入信号的处理(转) 冰封 2015-1-27 0/306 冰封 2015-1-27 21:17
common   FPGA开发经验连载(三) 数据接口的同步方法 冰封 2015-1-27 0/313 冰封 2015-1-27 21:16
common   FPGA开发经验连载(二) 串并转换设计技巧 串并转换是 冰封 2015-1-27 0/281 冰封 2015-1-27 21:15
common   FPGA开发经验连载(一) 冰封 2015-1-27 0/438 冰封 2015-1-27 21:14
common   分享:初学者如何学习FPGA? --part2 冰封 2015-1-27 0/383 冰封 2015-1-27 21:13
common   分享:初学者如何学习FPGA? --part1 冰封 2015-1-27 0/565 冰封 2015-1-27 21:12
common   在ISE启动modelsim时遇到问题与解决--ZT 冰封 2015-1-27 0/468 冰封 2015-1-27 21:11
common   ISE中下载Xilinx的bit文件失败时的处理方案:"DONE did not go high". 冰封 2015-1-27 0/368 冰封 2015-1-27 21:10
common   利用赛灵思开发工具克服FPGA I/O引脚分配挑战part2 冰封 2015-1-27 0/301 冰封 2015-1-27 21:10
common   利用赛灵思开发工具克服FPGA I/O引脚分配挑战part1 冰封 2015-1-27 0/340 冰封 2015-1-27 21:09
common   分享:modelsim下编译xilinx库的方法 冰封 2015-1-27 0/348 冰封 2015-1-27 21:08
common   谈谈如何利用FPGA开发板进行ASIC原型开发part2 冰封 2015-1-27 0/300 冰封 2015-1-27 21:07
common   谈谈如何利用FPGA开发板进行ASIC原型开发 冰封 2015-1-27 0/290 冰封 2015-1-27 21:06
common   基于FPGA的随机数发生器的实现以及利用ChipScope的验证--ZT 冰封 2015-1-27 0/298 冰封 2015-1-27 21:04
common   经验分享:写verilog代码要有硬件的概念--ZT 冰封 2015-1-27 0/350 冰封 2015-1-27 21:03
common   转贴:Xilinx中ise原语的使用 冰封 2015-1-27 0/376 冰封 2015-1-27 21:03
common   转贴:FPGA开发的十点经验 冰封 2015-1-27 0/336 冰封 2015-1-27 21:02
common   ISE中下载Xilinx的bit文件失败时的处理方案 冰封 2015-1-27 0/451 冰封 2015-1-27 21:01
common   一起学习FPGA开发之三--第3章 Verilog语言要素part4 冰封 2015-1-27 0/468 冰封 2015-1-27 21:01
common   一起学习FPGA开发之三--第3章 Verilog语言要素part3 冰封 2015-1-27 0/478 冰封 2015-1-27 21:00
common   一起学习FPGA开发之三--第3章 Verilog语言要素part2 冰封 2015-1-27 0/348 冰封 2015-1-27 20:56
common   一起学习FPGA开发之三--第3章 Verilog语言要素part1 冰封 2015-1-27 0/346 冰封 2015-1-27 20:54
common   一起学习FPGA开发之二--Verilog HDL简明教程(3) 冰封 2015-1-27 0/419 冰封 2015-1-27 20:53
common   一起学习FPGA开发之二--Verilog HDL简明教程(2) 冰封 2015-1-27 0/481 冰封 2015-1-27 20:52
common   一起学习FPGA开发连载之一:Verilog HDL简明教程(part1) 冰封 2015-1-27 0/348 冰封 2015-1-27 20:50
common   关于FPGA逻辑设计的21个小贴士 冰封 2015-1-27 0/369 冰封 2015-1-27 20:50
common   Adam Taylor玩转MicroZed系列64:Zynq应用分析 冰封 2015-1-27 0/414 冰封 2015-1-27 20:48
common   最大程度地扩大软件定义无线电的动态范围 冰封 2015-1-27 0/330 冰封 2015-1-27 20:47
common   灵活支持多重无线电标准 SDR进驻4G基地台/行动终端 冰封 2015-1-27 0/326 冰封 2015-1-27 20:47
common   基于动态重构技术的FPGA电路容错性能评估系统part2 冰封 2015-1-27 0/372 冰封 2015-1-27 20:46
common   基于动态重构技术的FPGA电路容错性能评估系统part1 冰封 2015-1-27 0/364 冰封 2015-1-27 20:45
common   赛灵思FPGA在多用户MIMO参考设计中的实时处理起关键作用 冰封 2015-1-27 0/490 冰封 2015-1-27 20:43
common   机器人技术基础系列:规划与导航 冰封 2015-1-27 0/442 冰封 2015-1-27 20:42
common   FPGA设计规划框架 冰封 2015-1-27 0/393 冰封 2015-1-27 20:41
common   在戛纳ECOC2014上28Gbps和25Gbps的广泛互操作性演示 冰封 2015-1-27 0/538 冰封 2015-1-27 20:40
    类型 排序方式 时间范围