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在设计FPGA时,有什么需要注意的

在设计FPGA时,有什么需要注意的

在进行FPGA设计时,有什么是必须要设计的啊?比如选通信号,时钟信号,读写信号,如果他再和DSP相连的话,有什么信号需要连在一起啊?

现在设计中有需要很多地方需要考虑的,这里可以提供一些思路:

时钟域的管理

命名技巧

同步设计

状态机

功耗

timing debug

等等

这个版主不太冷 =========================== 我的中电网博客:http://blog.chinaecnet.com/u/20/index.htm

谢谢。

有没有这方面的较好的资料啊?我这边有不少书,就是不知道从什么地方下手,目前正在学习VHDL语言

呵呵,楼主可以看看

华为同步电路设计规范:http://bbs.eccn.com/ecbbs/dispbbs.asp?BoardID=20&ID=16645&replyID=&skin=1

这个版主不太冷 =========================== 我的中电网博客:http://blog.chinaecnet.com/u/20/index.htm
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