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[求助]异步sram的时序如何模拟

[求助]异步sram的时序如何模拟

我需要在fpga上挂个异步sram作为buffer,读取速度至少要33.3MHz,我目前是把该异步sram作为同步sram处理,加入了一个同步的时钟信号,不知道这样可不可以,请指教,再请问大家,对异步sram一般是怎么设计的。
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