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whx8880发表于 2006-5-8 14:49 | 显示全部帖子

读ad的问题

时钟, 检测

请教大家：我的ad转换结束后输出三个eoc负脉冲，我要在第三个eoc的下降沿触发三个脉冲的读信号，每个要求100ns以上的低电平，感觉不难，可总是做不对，因为要同时检测eoc的下降沿和时钟的下降沿，大家给个思路

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whx8880发表于 2006-5-8 15:00 | 显示全部帖子

这样，容易丢吧

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whx8880发表于 2006-5-8 15:05 | 显示全部帖子

eoc是250ns的低电平，clk是25ns，没问题吗

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whx8880发表于 2006-5-8 15:16 | 显示全部帖子

再说只能检测一个信号的下降沿，不能同时检测两个下降沿，也不能将eoc低电平作为触发条件，否则容易多次触发

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whx8880发表于 2006-5-8 15:23 | 显示全部帖子

我要边沿触发，不是电平触发啊

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whx8880发表于 2006-5-9 09:45 | 显示全部帖子

我试了，不过我现在的simulation coverage is 85.11%, 有的时候更小，不是vhdl都能仿真吗，是我的仿真设置有问题吗

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whx8880发表于 2006-5-9 10:50 | 显示全部帖子

是这个问题，我用你说的方法试了，发现仿真的结果不完全正确，仿真覆盖率没有达到100%，那不能仿真的部分能综合吗，我下载到cpld中能正确运行吗

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