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FPGA/CPLD可编程逻辑
» 求助:CPLD里Z状态如何实现74373
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求助:CPLD里Z状态如何实现74373
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anotherchen
发表于 2006-6-12 17:43
|
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stone斑竹玩换头像啊??
楼上说得没错
最后要加一个else
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
┊也许生活本忙碌, 想享受安逸只能是心态了吧┊
╚☆→────────────────←☆╝ &
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anotherchen
发表于 2006-6-12 17:58
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应该与高阻状态有关
因为如果你将ZZZZ换成数值的话
不用加else也可以,因为dout会保持输出最后一个数值的数,
但dout应该不能保持输出ZZZZ
所以最后要加多一个else,将你所有情况下,都给dout一个数值输出
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
┊也许生活本忙碌, 想享受安逸只能是心态了吧┊
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anotherchen
发表于 2006-6-13 10:10
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就如A398356557所说的,在你发的程序里面加
else
ddd<="ZZZZ"; 就可以了,其他不需要改
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
┊也许生活本忙碌, 想享受安逸只能是心态了吧┊
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anotherchen
发表于 2006-6-13 14:59
|
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是数据时保持当前输出的数据,是Z状态保持Z状态之前的数据
这样的话,试试在else里面加个条件来实现吧
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
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anotherchen
发表于 2006-6-15 16:32
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你试试
else
当ddd=din时,dout=din
否则dout=ZZZZ
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
┊也许生活本忙碌, 想享受安逸只能是心态了吧┊
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