状态机设计与实现的讨论！！！ 状态, 设计, 讨论

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设计、编写了一些VHDL和VerilogHDL状态的代码，在测试和实验中，发现了在状态机设计和编写过程中有很多可以值得注意的问题，在下希望与各位一起就状态机的设计原理、状态机编码、状态转换条件、状态机中的延时、状态转换时的信号变化等问题一起讨论！