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[求助]请帮我看看verilog的程序,万分感谢!

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男 
1#
davidloved发表于 2006-8-30 17:12 | 显示全部帖子
always @(posedge outabc or posedge outabc)

你的那个always @(outabc）只代表outabc有变化，如果没有变化，一直是高电平，那就不会计数！
david
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