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[求助]LPM调用问题

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feelholder发表于 2007-7-26 14:19 | 显示全部帖子

[求助]LPM调用问题

LPM, 求助

我利用LPM库生成了一个fifo，现在想在顶层的设计中调用它，应该如何调用？

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feelholder发表于 2007-7-26 22:02 | 显示全部帖子

我是想在程序中调用

vhdl中可以用component调用，在verilog里面呢？

我在教材上没找到
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feelholder发表于 2007-7-28 11:37 | 显示全部帖子

在verilog中是不是直接fifo  f1（端口）这样就行了？

我向上面这样试过，这种情况下端口好像不能声明成reg型
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