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我现在做高速采集,数据是500M,经过STRATIX FPGA的lvds_rx模块将数据串并转换到125M,现在的问题是经过转
换后的数据对原数据有很大延迟,我怎么实现触发信号和转换后的数据信号的同步呢
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那要试吗?看看多少个 D触发器可以产生这么多延迟
有计算方法吗?
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