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我是刚开始学VHDL,哪位高手帮个忙

为什么一定要用wait for 啊? 看你的程序好像用after 也可以实现啊! 例如:test_clk <= '1' after clk_cycle/2;
能吃苦乃为志人 肯吃亏不是痴人 敬君子方显有德 怕小人不算无能 退一步天高地阔 让三分心平气和 知足之人心常乐 能忍气者身自安
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