TTL、CMOS器件的互连
器件的互连总则
在公司产品的某些单板上，有时需要在某些逻辑电平的器件之间进行互连。在不同逻辑电平器件之间进行互连时主要考虑以下几点：
1：电平关系，必须保证在各自的电平范围内工作，否则，不能满足正常逻辑功能，严重时会烧毁芯片。
2：驱动能力，必须根据器件的特性参数仔细考虑，计算和试验，否则很可能造成隐患，在电源波动，受到干扰时系统就会崩溃。
3：时延特性，在高速信号进行逻辑电平转换时，会带来较大的延时，设计时一定要充分考虑其容限。
4：选用电平转换逻辑芯片时应慎重考虑，反复对比。通常逻辑电平转换芯片为通用转换芯片，可靠性高，设计方便，简化了电路，但对于具体的设计电路一定要考虑以上三种情况，合理选用。
对于数字电路来说，各种器件所需的输入电流、输出驱动电流不同，为了驱动大电流器件、远距离传输、同时驱动多个器件，都需要审查电流驱动能力：输出电流应大于负载所需输入电流；另一方面，TTL、CMOS、ECL等输入、输出电平标准不一致，同时采用上述多种器件时应考虑电平之间的转换问题。
我们在电路设计中经常遇到不同的逻辑电平之间的互连，不同的互连方法对电路造成以下影响：
·对逻辑电平的影响。应保证合格的噪声容限（Vohmin－Vihmin≥0.4V，Vilmax－Volmax≥0.4V)，并且输出电压不超过输入电压允许范围。
·对上升/下降时间的影响。应保证Tplh和Tphl满足电路时序关系的要求和EMC的要求。
·对电压过冲的影响。过冲不应超出器件允许电压绝对最大值，否则有可能导致器件损坏。
TTL和CMOS的逻辑电平关系如上述图所示：
图2－1：TTL和CMOS的逻辑电平图；图2－2：低电压逻辑电平标准
3.3V 的逻辑电平标准如前面所述有三种，实际的3.3VTTL/CMOS逻辑器件的输入电平参数一般都使用LVTTL或3.3V逻辑电平标准（一般很少使用LVCMOS输入电平），输出电平参数在小电流负载时高低电平可分别接近电源电压和地电平（类似LVCMOS输出电平），在大电流负载时输出电平参数则接近LVTTL电平参数，所以输出电平参数也可归入3.3V逻辑电平，另外，一些公司的手册中将其归纳如LVTTL的输出逻辑电平，也可以。
在下面讨论逻辑电平的互连时，对3.3VTTL/CMOS的逻辑电平，我们就指的是3.3V逻辑电平或LVTTL逻辑电平。
常用的TTL和CMOS逻辑电平分类有：5VTTL、5V CMOS、3.3V TTL/CMOS、3.3V/5VTol.、和OC/OD门。
其中：
3.3V/5V Tol.是指输入是3.3V逻辑电平，但可以忍受5V电压的信号输入。
3.3V TTL/CMOS逻辑电平表示不能输入5V信号的逻辑电平，否则会出问题。
注意某些5V的CMOS逻辑器件，它也可以工作于3.3V的电压，但它与真正的3.3V器件（是LVTTL逻辑电平）不同，比如其VIH是2.31V（＝0.7×3.3V，工作于3.3V）（其实是LVCMOS逻辑输入电平），而不是2.0V，因而与真正的3.3V器件互连时工作不太可靠，使用时要特别注意，在设计时最好不要采用这类工作方式。
值得注意的是有些器件有单独的输入或输出电压管脚，此管脚接3.3V的电压时，器件的输入或输出逻辑电平为3.3V的逻辑电平信号，而当它接5V电压时，输入或输出的逻辑电平为5V的逻辑电平信号，此时应该按该管脚上接的电压的值来确定输入和输出的逻辑电平属于哪种分类。
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