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求助:关于JTAG和内部扫描,急!急!急!

求助:关于JTAG和内部扫描,急!急!急!

设计使FPGA芯片具有了内部扫描结构,然后仅通过JTAG边界扫描的四个端口,控制内部扫描链(如系统时钟和扫描时钟的切换,扫描数据的输入等),从而达到调试的目的,我想不明白的就是如何控制,哪位高手帮帮我吧,谢谢了!这是我的毕设,都快该交论文了,我还没头绪呢:(
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