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goodfan

刚学verilog，有一个项目要用到cpld.
具体是：
1.cpld接收一传感器数据（输出8位并行数据），接收两次（16bit） 构成一个完整数据。
2.cpld处理数据。（简单处理，二值化）即16bit 压缩为1bit, 将其存储。
3.返回执行1。执行16次。共得到16个压缩后bit数据。执行4
4.cpld输出16位处理后数据给arm。
以上功能，verilog 程序咋写？

sam_ccb

我帮不上忙,但也想知道下答案.能人给个answer

flanix

应该不难，用CASE 可以做的。