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新手,请教一个问题

新手,请教一个问题

我做的一个cpld电路,输入是几路同步脉冲信号,但是经过cpld转换之后,发现其中的一路产生了滞后的现象,而实际需求是输出同步的几路脉冲,请问一般可以采用什么方法解决?
如果几路处理的流程一样,不会有这样的问题啊!
如果逻辑不能改了,就打几层寄存器,滞后的那路少打寄存器,就补齐了
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