用于飞行器分离测速的数据采集处理系统 数据采集, 摄像机, 计算机, 飞行器, 稳定性

yuyang911220

摘要：一种多路实时测速系统。该系统能在飞行器分离时间内把分布于分离截面的各个测速传感器的信号采集至计算机内存，实时分析、处理得出飞行器分离过程的速度、加速度参数并得到整个的设计思想。实验结果表明，该系统具有良好的和稳定性和精度。
飞行器飞行中的分离速度是指爆炸螺栓爆炸裂后，各级助推器之间以及助推器与载荷之间的分离速度，是飞行器的关键参数之一，直接决定了飞行器能否安全分离。因而在飞行器的地面试验研究中，需要对飞行器分离速度进行测量分析。传统的测量方法是采用高速摄像机，飞行器分离时从各个角度进行高速摄像，事后对图像信号进行处理，从而获得飞行器分离的速度、加速度信息。但这种方式存在成本高、精度低、难以操作、实时性差等缺点。因此，随着飞行器试验研究的不断深入，迫切需要一种高精度、高性能价格比的测速系统。本文介绍了一种用于飞行器地面分离实验的计算机测速系统，系统示意图见图1。该系统包括传感器和计算机数据采集处理分析系统。多通道高速大容量数据采集处理分析系统是飞行器分离测速系统的关键部分。主要用于在飞行器分离时对均匀分布于飞行器分离截面的传感器信息进行6路并行零相差高速长时间不间断采集、实时或事后数据处理分析，从而得到飞行器分离的速度及加速度曲线。数据采集与处理系统由6通道数据采集卡、主控微机及系统主控、数据处理分析软件构成。该系统已成功地用于某飞行器的地面试验研究。
1 多通道并行高速数据采集卡
6路并行零相差高速数据采集卡主要用来对均匀分布于分离截面的6速度传感器信号进行采集。它主要包括可编程衰减放大器、高速D/A转换器、FPGA门阵列逻辑控制电路等几部分。其原理框图如图2。

    1.1 多通道数据采集卡的技术指标
（1）通道数：6个；
（2）采样频率：1MHz；
（3）数据分辨率：12位；
（4）大容量数据缓存：2×512K×12bits乒乓缓存，连续不间断采样数据量以主控微机可用内存为上限；

    （5）同步接口：任意通道触发采集，触发电平0～12V连续可调；
（6）模拟信号带宽：500kHz；
（7）模拟信号动态范围：0～12V；
（8）负延时长度：0～256KB即0～256ms可选；
（9）计算机接口：PCI接口。
1.2 6通道数据采集卡的设计
1.2.1 可编程衰减放大器
衰叛乱放大器将传感器模拟信号适当衰减后（衰减比例为4），送入宽带视频放大器放大，驱动相应通道的A/D转换器。由于传感器信号的幅度高达12V，远远超出了A/D转换器所以接受的2.5V的动态范围，因此设计了衰减电路，其衰减由RC衰减网络实现。

    1.2.2 6路并行A/D转换器
为了采集6路并行的位移传感器信号，系统需要6路并行的A/D转换电路。本系统采用了美国ANALOG DEVICE公司的12位高速单片A/D转换芯片AD9221作为A/D电路的核心器件。AD9221具有睡内采样保持电路以及低温度飘移系数的基准电源，仅以单一的+5V电源工作。它的无杂散动态范围可达80dB，很适合本系统的要求；同时高速A/D电路的模拟信号输入采用单电源的缓冲运算放大器，避免了毁灭性的ADC过激励。模拟信号缓冲及输入电路见图3。
1.2.3 FPGA门阵列逻辑控制电路
由于FPGA门阵列能够很好地提高系统的集成度和可靠性，本采集卡运用了一片超大规模门阵列完成了系统的逻辑控制。采用美国XILINX公司的基于SRAM技术的FPGA芯片XCS30。XCS30是XILINX公司SPATAN系列的门阵列，具有多达3万门可用资源。丰富的内部互连资源及512个宏单元中所包括的1024触发器能够很好地满足本系统的需求。该FPGA芯片主要完成的功能包括：计算机PCI接口电路、高速数据通道、采样控制电路，其内部原理框炉膛见图4。

    本采集系统的并行通道多达6个。为了更好地利用缓冲存储器，设计中运用FPGA产生多路到一路的高速数据通道，把6个速率为1MHz的12位数据流转换为一路乒乓切换的24位数据流，时序见图5。
采集卡的PCI接口控制电路采用了专用接口电路S5933。外围电路仅仅需要与S5933通信，得益于FPGA良好的可编程性，所有响应S5933访问的ADD-ON总线逻辑被集成于FPGA内部，并可根据需要进行动态可重构配置，以完成各种不同的功能。FPGA配合S5933的时序把采集卡上的两块缓存映射为PC机的两块内存，响应主控PATH-THROGH方式以单次或猝发连续模式读取采集卡上的数据；同时还响应主机根据S5933所设置的I/O端口访问，主控软件通过这样的端口访问实现对采集卡的配置、控制和状态查询以及响应采集卡的中断请求。
1.2.4 大容量缓冲存储器的设计
在飞行器实验中，需要长时间不间断地采集分离信息。一般来说，采样时间不少于10s。可以看到，实验的数据量相当巨大，大容量的数据存储器必不可少。解决这一问题有两个途径：一是增大采集卡缓存器的容量，但大容量静态RAM的成本较高；二是在接口速度足够快的条件下利用容量较大的控制主机的内存。峰值速率高达33M×32bits的PCI总线速度远大于采样的数据率，因此可以利用主机内存作为长时存储器。采集卡上必须有能采集并同时被主机访问的缓存器，因此设计了双路乒乓切换的大容量数据缓存器。

    采集卡所选用的存储器为HM628512。这是一种容量为512K×8位的高速静态存储器，其读写周期仅为20ns，可以较好地满足系统大数据量、高速存储的要求。在电路构成上，设计了两路存储器（A路、B路），通过FPGA提供的读写信号（OE、WE、CE）构成“乒乓开关”式结构。这种结构的好处在于对一组存储器进行写操作（即处于采集工作状态）θ的同时，主机对另外一组存储器进行读操作（即采集器向主机传输数据）。这样，使得采集器采集数据与传输数据能同时进行，使系统能不间断地采集数据，从而满足长时测速要求。
6通道A/D转换后组合成24位数据输出，每路需要用3片HM628512构成512K×24bits的缓存器。两路各3片HM628512的地址信号及控制信号都由FPGA给出。同一路的3片存储器以位扩展的方式连接在一起，共用一组地址线，数据线分开。为了实现两组存储器同时进行读写操作，需要将数据输入总线和输出总线隔离。采用FPGA进行地址发生及逻辑控制，极大地减小了系统设计的难度。双路存储器（A路，B路）的构成原理框图如图6。