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haifeng115发表于 2005-10-20 20:21 | 只看该作者

谢谢老大！haifeng115@sohu.com

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bjxiong发表于 2005-10-21 10:27 | 只看该作者

发过去了!

想看更多的东西？来我的博客,精彩多多！ http://blog.eccn.com/u/bjxiong/index.htm

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dogdogpig发表于 2005-10-21 14:30 | 只看该作者

我也很想要啊,谢谢!!顺便问一句,是针对Altera还是Xilinx讲的吗?
FRANKY_FXL@HOTMAIL.COM

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bjxiong发表于 2005-10-21 15:54 | 只看该作者

呵呵!发过去了!你自己看看吧

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xxxxdsp发表于 2005-10-22 15:06 | 只看该作者

谢谢，FPGA的多时钟分配问题我也要学习一下。cetcxtb@163.com

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xiwutengfei发表于 2005-10-28 16:33 | 只看该作者

xiwutengfei@163.com
谢谢了！

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bjxiong发表于 2005-10-28 17:28 | 只看该作者

查收!
不用谢,愿意效劳!

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zizileilei发表于 2005-10-28 19:40 | 只看该作者

谢谢，xq19801017@sohu.com

斯蒂芬

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flysnake发表于 2005-10-28 22:21 | 只看该作者

谢谢,tod_yuan@163.com

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zzz80675发表于 2005-10-30 19:30 | 只看该作者

谢谢，我想要 zzz80675@sohu.com

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bjxiong发表于 2005-10-31 16:36 | 只看该作者

查收

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xiongguisheng发表于 2005-11-1 10:32 | 只看该作者

谢谢

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gaoyf_2002发表于 2005-11-10 10:01 | 只看该作者

谢谢老大，能不能给发发一份？
gaoyf_2002@sina.com

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bjxiong发表于 2005-11-10 10:03 | 只看该作者

大型设计中FPGA的多时钟设计策略[分享]

时钟, FPGA, 设计, 分享

利用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线，本文将对这些设计策略深入阐述。

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[此贴子已经被作者于2005-11-10 10:03:39编辑过]

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bjxiong发表于 2005-11-10 10:05 | 只看该作者

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