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学verilog还是VHDL？

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ecnanjing发表于 2003-11-11 15:36 | 只看该作者
先搞好VHDL吧！
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xiaoyingying198 该用户已被删除
2#
xiaoyingying198发表于 2003-12-12 13:37 | 只看该作者
不是吧,许多IC设计的公司都是用verilog来编程.
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carol.yi@weiken 该用户已被删除
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carol.yi@weiken发表于 2003-12-12 13:58 | 只看该作者
Verilog 语法简单明了，适合初学者，VHDL语法严谨，但语法架构复杂
先学前者吧，熟一种语言，其它一样。
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carol.yi@weiken 该用户已被删除
4#
carol.yi@weiken发表于 2003-12-12 13:58 | 只看该作者
Verilog 语法简单明了，适合初学者，VHDL语法严谨，但语法架构复杂
先学前者吧，熟一种语言，其它一样。
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liming_nefu发表于 2004-1-2 09:09 | 只看该作者
xue
verilog hao!
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haozi1983发表于 2004-1-11 14:46 | 只看该作者
VHDL 好啊！！


有没有什么关于 VHDL的好书啊，，介绍下！！
sada
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游龙在天发表于 2004-1-27 16:16 | 只看该作者
verilog好。
爱我中华，抵制日货。
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ChinaBoy发表于 2004-2-1 22:17 | 只看该作者
都要学
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firststone发表于 2004-2-3 09:55 | 只看该作者
清华出版社好像有一本适合初学者的VHDL书还不错可以试试看
且夫，天地为烘炉兮造化为铜
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kerochan发表于 2004-2-6 21:59 | 只看该作者
VHDL好象语法更正规一点，比较适合。
反正我学的是VHDL，效果还不错。
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tenten发表于 2004-2-26 14:55 | 只看该作者
偶也是学VHDL的。
进行式。
我学自动化 我要自动化
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zzphj发表于 2004-3-2 22:09 | 只看该作者
我们课程设计老师在公司搞这个,他叫我们学习verilog,他说verilog是以后发展的趋势,越来越多的公司用它了
而且在极大规模电路的设计时verilog比VHDL好用
而且我们学起来容易上手
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iamatruehero发表于 2004-3-18 21:14 | 只看该作者
好象做ASIC的更偏向于VERILOG
反正我们这里都是用VERILOG
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jianhui0693@163 该用户已被删除
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jianhui0693@163发表于 2004-3-25 00:18 | 只看该作者
我给大家一个数据，对比一下，自己选：在美国、日本、我国台湾地区  verilog  ~VHDL
是：80%~20%，但在我国国内还没有明显的差别，今天下午刚看一本书介绍的。
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william879发表于 2004-3-28 12:31 | 只看该作者
在欧洲VHDL用的最多, 其他地方还是verilog
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