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建筑工地管理ZiMeiSoft
展恒中小企业项目管理软件SEPM-SME
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石化事故后果模拟软件DNV PHAST
石化安全风险计算软件SAFETI
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与风险计算Risk Calculation
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THERMOFLOW v15.0
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Virtuoso(r) Schematic Composer Verilog(r) Interface
Virtuoso(r) Schematic Composer
CADENCE(r) Analog Design Environment
Virtuoso(r) Compactor
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CADENCE(r) Chip Assembly Router
Dracula(r) Graphical User Interface
CADENCE(r) RC Network Reducer Option
Dracula(r) Physical Verification and Extraction Suite
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CADENCE(r) SPICE
Spectre(r) Circuit Simulator
Spectre(r)-RF Simulation Option
CADENCE(r) AMS Designer Environment
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Virtuoso(r) EDIF 200 Reader
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SPR002 Silicon Ensemble?-PKS Optimization
Dracula(r) Physical Verification and Extraction Suite
CM00030 CeltIC Crosstalk Analyzer for Cell-based Designs
CADENCE(r) NC-Sim Mixed-Language Simulator
CADENCE(r) Simulation Analysis Environment
CADENCE(r) Verification Cockpit
V29 FormalCheck(r) Model Checker
BG100 BuildGates(r) Synthesis
HDS2000 CADENCE(r) Hardware Design System 2000
MDK CADENCE(r) Multimedia Design Kit
SPW2000 CADENCE(r) Signal Processing Worksystem 2000
IS136VE CADENCE(r) IS136 Verification Environment
NCSPW CADENCE(r) Signal Processing Worksystem link to NC Simulators
GSMVE CADENCE(r) GSM Verification Environment
PCSCDM***E CADENCE(r) PCS CDMA Verification Environment
COMFLT CADENCE(r) Communication Library - Floating Point
COMTK CADENCE(r) Communication Library - Fixed Point
CDMATK CADENCE(r) Wideband CDMA Library
MDM CADENCE(r) SPW Model Manager
WLAN CADENCE(r) Wireless Local Area Networks Library
1. 逻辑设计与验证工具
逻辑仿真工具: CADENCE NC-Verilog, Verilog-XL, NCSim, Simvision W***eform
Viewer
综合工具: CADENCE BuildGates
形式验证工具: VerplexLEC
2. 综合布局布线工具
SoC Encounter－可应用于如90nm及其以下的SOC设计；
SE-PKS－可应用于如复杂时序收敛的IC设计；
Fire & Ice QX and SignalStorm－可应用于3维电阻电容参数提取及延时计算；
VoltageStorm－可应用于功耗分析；
CeltIC－可应用于信号完整性分析。
3. system level design工具
综合（Hardware Design System 2000）
算法验证（SPW）
结构设计工具(SystemC-based simulators, CoWare, etc)
硬件/软件混合设计工具(Verification Platform, Seamless, etc)
模拟/混合信号工具(AMS, Agilent ADS, etc)
4. CIC(layout & custom layout) 全定制集成电路布局设计工具
Virtuoso Layout Editor
Assura (Layout verification)
5. AMS (analog mixed signal, RF analysis and design)模拟集成电路设计工具
AnalogDesignEnvironment
MixedSignal Design Environment
Analog Modeling with Verilog-A
Spectre Circuit Simulator
6. HS-PSD(high speed PCB system design) 高速系统和板极设计工具
Concept HDL Front-to-Back Design Flow－原理图输入工具
PCB Librarian－器件建库工具
Allegro PCB Layout System－PCB板布局布线工具
Specctra AutoRoute Basics－基本自动布线器
Advanced Specctra Autorouting Techniques－高级自动布线器
SpecctraQuest Foundations－信号完整性仿真工具
Advanced SpecctraQuest Techniques－高级信号仿真工具
入门CADENCE推荐套装
VerilogHDL仿真工具－Verilog-XL
电路设计工具－Composer
电路模拟工具－Analog Artist
版图设计工具－Virtuoso Layout Editor
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