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verilog一问!!!

verilog一问!!!

程序仿真时没有问题,但综合时却出现如下错误,哪位高手指点一下,thanks


WARNING:Xst:528 - Multi-source in Unit <fifo> on signal <read_ptr1<2>1> not replaced by logic
Signal is stuck at GND
WARNING:Xst:528 - Multi-source in Unit <fifo> on signal <read_ptr1<1>1> not replaced by logic
Signal is stuck at VCC
WARNING:Xst:528 - Multi-source in Unit <fifo> on signal <read_ptr1<0>1> not replaced by logic
Signal is stuck at GND

很多warning是没有关系的
特别是你使用其他模块时,对没有使用的信号,它就会用warning提醒你

把eroor找出来把
email:zhenzhen1017@163.com  
综合时就出现了类似与上面的warning,就直接出来了ERROR:Xst:415 - Synthesis failed,不是warning的问题那是什么问题?  谢谢
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