请问MAX+PLUS2中如何产生一个17进制的计数器？ - FPGA/CPLD可编程逻辑 - 电子技术论坛_中国专业的电子工程师学习交流社区-中电网技术论坛 - Powered by Eccn

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请问MAX+PLUS2中如何产生一个17进制的计数器？

新手上路

Rank: 1

UID: 72869
性别: 男

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timorthy发表于 2003-8-1 13:59 | 只看该作者

解释的好详细呀。佩服佩服。

__▁▂▃▁__ ﹀　　落霞与孤骛齐飞，　　　　﹀ _▁▂▃__ 　　秋水共长天一色。　　__▁▂▁___ ﹀﹋ ● 　　　　﹋﹀　　　　█▆▅▇▆▅▄▃▄▅▆▄▅▄▃▂▃▄▆▅▇▆▄▅█▇▆▄▂▃▅　　　-__~~--___-▔~~__--__~~~_---

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shirleydp@sohu.发表于 2003-8-1 13:59 | 只看该作者

要不你再发一个到shirley.d1@163.com，sohu的我还是没收到，不知道怎么回事情。太麻烦你了，我都不好意思了：）

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shirleydp@sohu.发表于 2003-8-1 14:06 | 只看该作者

收到了，太感谢您了。：）

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shirleydp@sohu.发表于 2003-8-1 14:21 | 只看该作者

我重新仿真了一下，这次我的DATA选择的是DEC格式的，看起来是在记数了，结果也是对的，可是我的结果偶数显示全为0，怎么回事，我哪里设置的不对吗？我把结果发到你的邮箱了。

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shirleydp@sohu.发表于 2003-8-1 14:52 | 只看该作者

这次我选择的器件是AUTO，前面用的是EPM7128SLC84-6，GRID SIZE 调为100ns，偶数值还是为0，这种问题以前我从来都没遇到过

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shirleydp@sohu.发表于 2003-8-1 15:00 | 只看该作者

好了，正常了，我重新加了信号，现在和你的结果一样了，太感谢您了。浪费了您这么多的时间，不好意思

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shirleydp@sohu.发表于 2003-8-1 15:10 | 只看该作者

10.2baseline

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shirleydp@sohu.发表于 2003-8-1 15:22 | 只看该作者

谢谢，请问你是怎么生成的？我才开始学习CPLD，还有很多东西不明白，我都不知道怎么学，现在就是看看别人的代码，自己写点简单的东东。您能指点一下方向吗？

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shirleydp@sohu.发表于 2003-8-1 15:34 | 只看该作者

是个仿真软件吗？类似于symplify吗？他自己生成代码吗？

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shirleydp@sohu.发表于 2003-8-1 15:40 | 只看该作者

我在网上查到一个，是FTP的，我不知道怎么下。

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shirleydp@sohu.发表于 2003-8-1 15:45 | 只看该作者

你对FPGA很熟吧，我现在还在CPLD的门外徘徊，我不知道从何入手，能指点一下吗？

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shirleydp@sohu.发表于 2003-8-1 15:52 | 只看该作者

USB吗？想和你交个朋友，我是重大的

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shirleydp@sohu.发表于 2003-8-1 16:01 | 只看该作者

很高兴认识你，你有QQ吗，这个实在太慢了，呵呵

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shirleydp@sohu.发表于 2003-8-1 16:07 | 只看该作者

我的地址也是刚才发的邮箱名称

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shirleydp@sohu.发表于 2003-8-1 16:21 | 只看该作者

麻烦你等以下，我着台PC上没有MSN，我正在下

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