新手江湖救急

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winner_chen@21c发表于 2003-8-29 18:12 | 只看该作者

新手江湖救急

新手, 江湖, 救急

新手，请求援助。
　　用CPLD的芯片做C51的总线分离，内部用原理图画出５７３，２４４，１３８，００简单电路，为什么分离后的总线CPU频率高一些到12M就不能用了，６M还可以。CPU程序在分离元件搭的总线上是用的很好的。可以上到２４M呢。
　　难道６０块的CPLD作出的逻辑电路，延时时间比１块钱的７４系列还严重？？？
　　我用altera的EPM7128SLI84片子，datasheet上说可以上到５０M呢！！

　　请哪位高手赐教一下，小弟不胜感激。

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zqwu发表于 2003-8-29 18:12 | 只看该作者

CPLD的延时与数据通道的长度有关

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