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请问在DSP Builder里,如何生成Verilog文件?

请问在DSP Builder里,如何生成Verilog文件?

我在用DSP Builder,生成的文件都是VHDL的,不知道哪位高人知道如何生成Verilog文件?


同事说不能生成Verilog文件,但是能有软件转换,各位有知道的吗?谢谢各位的指点!

我没有用过dsp builder,在构建nios的过程中,在刚开始构建的时候就有提示是生成verilog还是vhdl的,在dsp builder中没有吗
在交流中前进,共同实现nios的应用。
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