学习Verilog必走的3个阶段
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// 入门篇: (秋干勿燥,冬去春来)
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01. 建立项目
02. Verilog
a). nand/nor/and/or;
b). assignment;
c). always;
04. 选设device
05. Settings:
a). 加减文件;
b). 设置top module文件;
c). 设置classic timing时序仿真主时钟fMAX;(可以不设)
06. 编译(直接选按钮)
07. 仿真(直接选按钮)
a). 创建.vwf波形文件,
b). 添加netlist节点,
c). 设置激励波形;
d). 设置仿真波形文件
e). 阅读并判断仿真结果的正确性 |
