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关键字：数字频率合成 DDS 正弦信号发生器 CPLD FPGA
1 引言
直接数字频率合成DDS(Direct Digital Syndaesis)是实现数字化的一项关键技术，广泛应用于电信与电子仪器领域。DDS通常是在CPLD或FPGA内设置逻辑电路实现的，但由于DDS输出受到D/A转换器的速率及D/A转换后I/V转换中运放的带宽增益和响应时间的限制，CPLD和FPGA内部实现方案在高频段信号幅值已不稳定。因此，这里介绍一种基于DDS器件AD9851的信号发生器设计方案。
2 AD9851简介
AD9851是ADI公司采用先进CMOS技术生产的具有高集成度的直接数字频率合成器。该器件频带宽、频率与相位均可控，内部频率累加器和相位累加器相互独立，32位调频字使得其在180MHz的系统时钟下输出频率可达0.04Hz的高分辨率。
设相位累加器的位数为N，相位控制字的值为FK，频率控制字的位数为M，频率控制字的值为FM，内部工作时钟为FC，最终合成信号的频率F相位和θ分别为：
F=FMFC/2N，θ=2πFN/2M
AD9851的最高工作时钟为180MHz，实际电路中，外部晶体振荡器的频率为25MHz，由经内部集成的6倍频器和高速比较器得到150MHz的时钟信号，这样可减小高频辐射，提高系统的电磁兼容能力。AD9851内部集成高速DDS和10位高速A/D转换器，故无需D/A转换和I/V，转换等容易影响DDS输出的单元。
3 系统总体设计方案
图1为系统设计框图。为了产生调制信号，需要在FPGA内部实现低频段的DDS模块以产生正弦波(模拟调制AM和FM)和二进制基带码(数字调制ASK/FSK/PSK)。由于AD9851输出的正弦信号存在谐波，因此需加一个无源滤波器滤波。由于无源滤波的衰减特性，为使信号源的最终输出信号幅值稳定，系统需加一级AGC电路。PGA程控放大器采用DAC7611作为基准控制输出信号的幅度。AM电路采用模拟乘法器AD835构成，ASK调制较简单，直接用DDS产生的二进制基带序列控制模拟开关，从而控制AD9851信号的输出。最后由多路选择器和OPA690功放电路控制输出。
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