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嵌入式设计人员面临的最大挑战之一就是界定系统的性能需求。用以确定实际性能需求所需的信息要么无法获取，要么难以获得。最精确的估算有时也会因无法预料的计算负荷而失效。分析通常会指出，对于数据处理需求而言嵌入式处理系统的成本效益太低。因此，系统设计人员高度渴望拥有可扩展的能够适应性能需求潜在变化以及能够执行高性能数据处理的架构。而在FPGA内部实施的控制平面/数据平面处理架构就能够有效满足上述要求。
什么是控制平面/数据平面处理？为什么您的下一代嵌入式系统可能会需要它？
在无法用软件完成所有处理工作的系统中，设计人员可以通过多种途径来获得其他性能。他们可以采用对称或者非对称处理配置的多处理器；使用硬件协处理器；或者将数据处理任务拆分给一个或多个专用处理单元——就像在控制平面/数据平面内进行处理一样。
在这种编程方式下，数据处理被分成两个不同的平面。控制平面代表着对性能影响不大的算法元素，比如管理性任务、用户界面和操作系统功能。同时，数据平面代表着数据在系统中的流动，例如视频流或音频流及其处理。在数据平面上，设计人员采用诸如流水线这样的技术来增强数据吞吐能力。控制平面/数据平面处理的典型应用包括流视频、网络包处理以及高速信号处理。
让我们来近距离观察一个涉及流数据实时处理的控制平面/数据平面应用。我们将面临高清视频流特有模式的识别。该实要求混合使用高性能数据处理和包含嵌入式微处理器的控制功能的多种应用的典型代表。
720p/60Hz的HD视频流的像素频率为74.25MHz。这就要求222.75MB每秒的处理速率。假定采用2.5GHz的双核双指令处理器来处理该数据，最佳的指令率为10G指令每秒。这样的处理器可针对所处理数据的每一字节执行22.4条指令。对某些应用而言这已经足够了，但22.4条指令表明所能处理的数据非常有限。复杂的视频处理功能，比如内核卷积（kernelconvolution）、噪音消减和其他过滤功能需要更高的指令执行效率。本文的解决方案准备在数据平面上创建并行或流水线处理单元。
HD视频处理是一种可以把问题划分为控制平面和数据平面予以高效处理的常见的现实应用。作为一种高度并行处理单元，FPGA在本例中负责视频处理，同时由FPGA内部的中等性能处理器负责视频处理流水线。该处理器可专用于单个应用，也可以运行诸如Linux这样的操作系统。最终形成的硬软件混合实施方案可以把处理交付给能够进行最佳处理的部分，实现低成本、高性能数据处理解决方案。图1显示的是典型的控制平面/数据平面系统。
图1：典型的控制平面/数据平面处理系统。
采用FPGA实现计算负载均衡
除了不菲的ASIC，FPGA是性能最高、最具经济效益的流数据处理单元实施方法。FPGA因其灵活的架构而能让设计人员实施包含并行和流水线单元的处理系统。这样设计人员即可优化系统的性能和时延。
设计人员随后可以将该数据平面解决方案应用于外部的分立微处理器以进行控制。在FPGA内部加入该处理器能够带来多项优势。内部处理器能够大大减少处理器和数据平面单元之间的控制时延。时延的减少可以释放出许多处理器周期。外部处理器必须与数据平面保持通信。通信通道可以是32位或者更多位数，并同时需要更多导线用于寻址和控制。增加的导线可能会要求更强大的处理器和FPGA封装，从而导致系统成本增加。而采用PCIExpress（PCIe）能大幅度减少引脚数量。遗憾的是，不是所有的处理器和FPGA都支持这种相对新型的接口，而且即便支持，PCIe器件的成本也大大高于不采用PCIe的同类器件。
在FPGA内部实施控制平面处理器和数据平面可以减少器件数量、板级空间和功耗，最终形成一个低成本的解决方案。在FPGA内既有诸如PowerPC等硬核处理器，也有赛灵思MicroBlaze等软核处理器，可以根据应用要求配置基于FPGA的处理器。基于FPGA的系统能够在处理器和FPGA逻辑之间移植决策和计算功能，从而实现系统级的优化。
控制平面/数据平面系统的实施
某些工具可以简化基于FPGA的控制平面/数据平面系统的实施。使用向导或者通过调整现有参考设计来编译系统是其中两种常用的方法。
通过向导FPGA工具可迅速汇编微处理器系统。使用下拉列表或者复选框，您可以轻松地指定目标部件以及需要的处理器和外设。同时，可以使用诸如MATLAB软件这样的工具来迅速编译具有处理器总线接口的信号处理流水线以用于控制。另外，还可以使用C-to-HDL工具构建数字信号流水线。控制平面/数据平面的连接可以简单地通过匹配总线接口来完成。图2显示的是启动向导的说明窗口和用向导构建的最终系统。
图2：向导启动屏幕截图和已完成的系统。
第二种方法是调整现有的参考设计。FPGA参考设计不断发展并已成为市场的焦点。在我们的案例研究中使用的参考设计具有完整的微处理器系统、存储器、外设和720pHD数字信号处理流水线。因此，该系统相当于一款完整的控制平面/数据平面解决方案。在该参考设计中，由处理器控制增益和流水线中的FIR滤波器。使用C-to-FPGA工具创建目标探测和高亮显示模块，让整个系统具备功能所化的时间不到20个小时。
该处理器可以使用板卡支持包（BSP）提供的补充驱动程序来控制数据流水线。目前已有面向Linux的驱动程序，可以让处理器直接控制数据处理流水线。Linux调用包括从Linux应用中打开I/O器件，然后针对该器件进行读出或者写入。 |
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