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FPGA/CPLD可编程逻辑
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FPGA正常操作关开机N次后,某些模块失灵
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yuchengze
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yuchengze
发表于 2016-11-24 17:35
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只看该作者
FPGA正常操作关开机N次后,某些模块失灵
上电
,
影响
求帮助
我想问一下,fpga上电后,加载出现问题了,我选择的是“重新加载”,这样对我的系统有什么影响吗?
还有就是crc_error那个引脚只要设置使能就能输出标志电平了吗?
我现在遇到当我重复开关机+操作后,几百次后某一次再次上电就会感觉到FPGA发送的数据不对了,让他操作复位,有的可以正常操作,有的就不听话了,就发固定的数据,不是随着我的操作命令走了。我用的都是一个时钟,时钟方面应该是没有问题。
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