altera 的cyclone 系列的pll输入时钟有限制吗？
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altera 的cyclone 系列的pll输入时钟有限制吗？
请问altera 的cyclone 系列的pll中，输入clk的频率有什么限制没有？最低时钟频率是多少？能输入2.048MHz吗？ 谢谢了！ |
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| 输入时钟有限制，要使用pll，clk必须大约16M。而且pll不能分频 |
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这个版主不太冷
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| 那要是想分频应该用什么ip核啊？？[em06][em06] |
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