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anan

verilog 数字系统设计教程


和c很像 可是仍有不同 界限很难划定

迷惑

caopengly

其实verilog和c有很大的不同 ，我们在写rtl的时候心里像的都是硬件，而且设计的语句很简单，关键是对结构的考虑

而c完全不同，这个是按照顺序来执行。

所以楼主多写些rtl就知道区别，有很大的不同。如果用c的思维去写rtl的话就完了。

wydzaaaa

数字万用表套件830B


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