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verilogA中怎么遍历一个bus信号?

verilogA中怎么遍历一个bus信号?

模块里有个bus输出。 叫data_out[31:0]

我是否可以用

integer i;

for(i=0;i<31;i=i+1)

data_out<+xxxxx;

这种形式来访问?

你用的是什么编译器?

人要保持斗志,并有疯狂的追求,生活才会精彩! QQ:24387110 手机:13871563876
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