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Xilinx 技术论坛 (Xilinx Technical Discussion Foru)
» [讨论]如何提高设计系统的频率
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[讨论]如何提高设计系统的频率
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phdb
发表于 2006-4-5 10:45
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只看该作者
[讨论]如何提高设计系统的频率
频率
,
系统
,
设计
,
讨论
如题,如何来提高设计系统的频率,偶知道使用时序约
束是可以的,但是有限,哪位打下近来侃侃,让兄弟们
长些见识
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stone133
发表于 2006-4-5 23:41
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只看该作者
1。优化你的算法,例如使用流水线;
2。某些关键地方使用程序自带模块(一般来说程序自带的比自己实现的效率要高)
美梦成真-->噩梦降临!
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phdb
发表于 2006-4-6 09:26
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只看该作者
嗯,我觉得优化算法是可行的;但是把时钟调高后,要保证时许的正确可能就不太好实现了吧
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hesperus
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hesperus
发表于 2006-4-7 02:46
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只看该作者
看Timing report,谁慢就搞谁,哈哈。通常如果又很多模块,那总是有可以跑得快的,又可以跑得慢的,也可以考虑分开来做。还有涉及IO的时候会很麻烦,因为timing要依赖于外面的电路。
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