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在FPGA的时序设计中经常产生毛刺，请问如何避免?

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guihua发表于 2006-7-28 09:56 | 只看该作者

在FPGA的时序设计中经常产生毛刺，请问如何避免?

时序, 毛刺, FPGA, 设计
在FPGA的时序设计中经常产生毛刺，请问如何避免?
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stone133发表于 2006-7-28 23:38 | 只看该作者
最简单的就是加寄存器，但是这样会产生一定的延时；组合逻辑尽量不要和时序逻辑纠缠在一起；
美梦成真-->噩梦降临！
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anotherchen发表于 2006-7-29 11:58 | 只看该作者
如果时钟就有毛刺呢？
应怎样处理
╔☆→────────────────←☆╗
┊寻觅在电子中, , , 寻求适合自己的一席┊┊┊┊
┊也许生活本忙碌,  想享受安逸只能是心态了吧┊
╚☆→────────────────←☆╝      &
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stone133发表于 2006-7-29 16:13 | 只看该作者
时钟有毛刺可是不行，你的时钟是不是用了很多组合逻辑产生出来的？这样的做法是要尽量避免的
美梦成真-->噩梦降临！
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yin_wt发表于 2006-7-30 16:47 | 只看该作者
避免门控时钟
ASIC可以用来降低功耗
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luohongken发表于 2006-8-1 11:45 | 只看该作者
可以增加D触发器试试
Simple is Best!
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george_ljl发表于 2006-8-17 11:26 | 只看该作者
如果毛刺时间很小可以不去考虑它
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