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请问怎样设计CPLD,让单片机像读写RAM一样读写CPLD?

请问怎样设计CPLD,让单片机像读写RAM一样读写CPLD?

如题。
在CPLD内部做一个RAM,单片机就可以读写了
美梦成真-->噩梦降临!
cpld内部作RAM?有点不实际吧?按照单片机的总线时序写个模块就是了。频率不高
我就是这个意思,但不知道具体应该怎样做?
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