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珊瑚虫发表于 2005-12-29 08:28 | 只看该作者

紧急求助：关于时钟

时钟, 求助

我的板子上有一个44b0，一个fpga(ep1c3t144)
我想用一个10M的有源晶振同时给它们两者提供时钟。原来的设计是：直接从有源晶振分出了两路，每个支路各放了一个22ohm的电阻，然后分别接到44b0和fpga的时钟输入引脚.

不过听说这样做时钟负荷会很大，不太好
请问各位大侠：
是这样的吗？能共用一个晶振吗

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stone133发表于 2006-3-8 19:43 | 只看该作者

对时钟要求不高的时候可以这样用
但是如果后段对时钟有较高的要求，比如抖动和驱动方面的。如果你fpga里面时钟驱动比较重的话，有可能出问题，建议用个时钟驱动芯片，不大，不贵，很简单

美梦成真-->噩梦降临！

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32kmcu发表于 2006-3-8 22:06 | 只看该作者

是的,楼上说的不错,这样可以避免两根时钟线彼此的反射干扰,恶化时钟信号.你所接的22OHM电阻就是用来匹配阻抗以避免反射的.
加个BUFFER可以完全避免这个事情,而且驱动能力和时钟信号都要好很多.

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boyfly发表于 2006-3-10 09:18 | 只看该作者

一般来说1个晶振驱动2个ic应该没有问题，你的时钟不高，所以你可以采用32kmcu的办法，比如10M时钟给了一个74F04的2个输入脚，则会输出2个10M的时钟,分别给FPGA和44B0

我是天堂的使者，向我倾诉吧

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32kmcu发表于 2006-3-10 10:28 | 只看该作者

是stone133说的办法,呵呵.
加专用BUFFER是最理想的.

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stone133发表于 2006-3-10 10:53 | 只看该作者

哈哈，大家一个意见！
补充一点：有专用的时钟驱动芯片（例如ICS551），比74的片子贵不了多少，而且有多路输出

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zzchulufengmang发表于 2006-3-23 10:13 | 只看该作者

楼主，帮帮我啊，我一点头绪都没有，我们毕业设计就是这个，求赐教

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stone133发表于 2006-3-23 11:57 | 只看该作者

帮你什么？你需要什么东西？

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zzchulufengmang发表于 2006-3-24 10:38 | 只看该作者

用CPLD设计数字钟,的硬件实现的原理图.
5555
我不会

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