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FPGA/CPLD可编程逻辑
» [求助]epm7128使用的问题
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[求助]epm7128使用的问题
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dlx69
发表于 2006-5-30 23:17
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只看该作者
[求助]epm7128使用的问题
求助
我用epm7128去联络51单片机和md8251a,具体连接为cpu的wr rd和p20通过epm7128的wire分别连接到md8251a的wr rd和a0,md8251a的片选通过cpld的138元件译码给出,结果epm7128和md8251a工作时均有点热且工作一段时间后就不能进行通讯了,请问是什么原因。
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stone133
发表于 2006-5-31 18:09
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只看该作者
检查一下你的电源再不工作的时候电压是不是被拉下来了,看看你的电源芯片是不是过热
美梦成真-->噩梦降临!
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dlx69
发表于 2006-6-7 22:21
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只看该作者
电源没有问题,其他部分工作正常,晶振使得是4.9152m的,另外8251的clk也是通过cpld引入的,另外在cpld的内部我还用d触发器作了一个32倍的分频器,给8251的txd和rxd的时钟端。现在工作还是时好时坏,是不是因为毛刺,另外时钟4.9152m我是通过普通io口引入的,没有用全局时钟。谢谢
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stone133
发表于 2006-6-8 09:16
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只看该作者
从“工作一段时间后就不能进行通讯”这个现象来看:
1。不像是毛刺造成的,但是为了排除这个可能,你输出的时候加一个锁存器;
2。时钟4.9152m扇出如果不是很大,从普通io引入也是可以的;
3.“工作一段时间后就不能进行通讯”和“工作是时好时坏”这两个现象是哪一个?
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dlx69
发表于 2006-6-8 12:44
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只看该作者
不好意思,是工作一段时间后就不能进行通讯
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dlx69
发表于 2006-6-8 12:47
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只看该作者
另外4.9152m就带了两个cpld,都是从普通io输入的
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发表于 2006-6-8 17:02
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只看该作者
1。“工作一段时间后就不能进行通讯”基本说明你的程序没有问题;
2。4.9152m带了两个cpld,每个cpld里面对这个时钟的使用量很大吗?如果很大,lz方便的话,最好加一个时钟驱动芯片;在不正常的时候你可以测以下晶振的输出是不是还正常;
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发表于 2006-6-10 21:24
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只看该作者
其中一片给两个部件提供时钟,另一片带8251的给8251提供clk和波特率时钟,另外还给其他一个部件提供时钟。所有时钟分频我都是采用d触发器做的分频,后来在所有时钟的输出端加了一个d锁存器结果还是8251工作一段时间后就不能进行通讯,其他设备工作均正常。
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发表于 2006-6-10 21:26
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只看该作者
忘了说了,其他几个部件我使用cpld内部资源实现的,外部芯片就一片8251
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发表于 2006-6-11 20:43
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只看该作者
1。你在cpld里面实现的功能不复杂,我觉得时序应该不会有问题,8251的应用,时钟频率应该不会很高吧?用d触发器做分频我认为也能满足需要;
2。我们以前碰到工作一会就不正常的情况总是电源的问题;
3。正常工作能坚持多久?cpld有复位吗?不正常以后复位管用吗?
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发表于 2006-6-12 21:28
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只看该作者
我没辙了,就把4.9152m的晶振的信号直接连接到8251的clk端,波特率还是采用cpld的资源进行的分频,结果我通电试了12个小时没出问题,仅8251有点热,也弄不清怎么回事了。cpld的所有全局信号我都接地了。外部复位没有。
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发表于 2006-6-14 11:06
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只看该作者
lz的意思是送给8251的clk信号不能通过cpld?一通过就出问题?
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发表于 2006-6-14 14:41
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只看该作者
是的,给8251波特率的信号15.36K还通过cpld进行的,以前送给8251的clk信号一种是通过wire给,一种是进行分频,都有工作一段时间后就不能进行通讯的现象发生。还请斑竹指正
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发表于 2006-6-14 15:14
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只看该作者
lz可以用示波器测量一下通过cpld后的clk信号,看看有没有边形失真或者幅度很低的情况;
在通过cpld后的clk信号输出端上加一个上拉电阻试试看;
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发表于 2006-6-14 21:19
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好的,谢谢斑竹,我现在手头没有示波器,等我回到单位测完了,再把具体情况向斑竹作一汇报。最后再真诚地说声谢谢。
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