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always expecting description什么意思?求解释

always expecting description什么意思?求解释

// create FIFOADR
module fifo
always @ (posedge CLK)
 begin
  if (!RESET) FIFOADR_ reg < = 2′b11;  / /本设计只需用EP2和EP6
  else if (RD_disk_buf2 = = 1′b0 ) F IFOADR_ reg < = 2′b10;  / /最好对控制线RD2disk锁存2拍
   else if ( WR_disk_buf2 = = 1′b0 ) F IFOADR_reg < =2′b00;
    else F IFOADR_reg < = 2′b11;
 end
代码就是这个,为什么报标题中的错误?怎么解决?请高手解答,谢谢了。
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