首页 | 新闻 | 新品 | 文库 | 方案 | 视频 | 下载 | 商城 | 开发板 | 数据中心 | 座谈新版 | 培训 | 工具 | 博客 | 论坛 | 百科 | GEC | 活动 | 主题月 | 电子展
返回列表 回复 发帖

verilog hdl的一个问题!

verilog hdl的一个问题!

使用条件操作符, 编写赋值语句选择NextState的值。如果CurrentState的值
为RESET, 那么NextState的值为GO;如果CurentState的值为GO,则NextState的值为BUSY;如果CurrentState的值为BUSY;则NextState的值为RESET.
这个怎么写阿,各位大虾!
case (CurrentState) RESET:NextState<=GO; GO:NextState<=BUSY; BUSY:NextState<=RESET; endcase
返回列表