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FPGA/CPLD可编程逻辑
» 编译没有问题 但是时序仿真总不对,这样可以向CPLD内烧写程序吗?
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编译没有问题 但是时序仿真总不对,这样可以向CPLD内烧写程序吗?
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基洛级
发表于 2006-6-27 22:23
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只看该作者
编译没有问题 但是时序仿真总不对,这样可以向CPLD内烧写程序吗?
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CPLD
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编译
编译没有问题 功能仿真也没有问题但是时序仿真总不对,这样可以向CPLD内烧写程序吗?
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stone133
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stone133
发表于 2006-6-28 08:15
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只看该作者
只要你生成了程序文件就可以烧写,但是得到的结果会有问题,时序仿真得到的基本就是实际硬件的结果,所以你还是排除掉错误再写吧
美梦成真-->噩梦降临!
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dawn-star
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dawn-star
发表于 2006-6-28 18:27
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只看该作者
nod!
我不要回到火星上去!
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