首页 | 新闻 | 新品 | 文库 | 方案 | 视频 | 下载 | 商城 | 开发板 | 数据中心 | 座谈新版 | 培训 | 工具 | 博客 | 论坛 | 百科 | GEC | 活动 | 主题月 | 电子展

FPGA/CPLD可编程逻辑

[ 26527 主题 / 25683 回复 ]

版块介绍: 讨论关于FPGA和CPLD的相关话题!

版主: boyfly, stone133, flanix, bydxdtcdj, 电子狂热, xcx_hust, benbenfei, AndyLee008

FPGA/CPLD可编程逻辑

    标题 作者 回复/查看 最后发表
common   基于DSP和CPLD的智能相机系统设计与研制(2) yuyang911220 2015-1-25 0/404 yuyang911220 2015-1-25 15:12
common   基于DSP和CPLD的智能相机系统设计与研制 yuyang911220 2015-1-25 0/443 yuyang911220 2015-1-25 15:11
common   DSP和FPGA在汽车电子中的广泛应用(2) yuyang911220 2015-1-25 0/470 yuyang911220 2015-1-25 15:11
common   DSP和FPGA在汽车电子中的广泛应用 yuyang911220 2015-1-25 0/671 yuyang911220 2015-1-25 15:10
common   基于FPGA的多路数字信号复分接器的设计(2) yuyang911220 2015-1-25 0/360 yuyang911220 2015-1-25 15:09
common   基于FPGA的多路数字信号复分接器的设计 yuyang911220 2015-1-25 0/585 yuyang911220 2015-1-25 15:09
common   半加器与全加器 yuyang911220 2015-1-25 0/564 yuyang911220 2015-1-25 14:50
common   verilog实现多位数值比较器 yuyang911220 2015-1-25 0/455 yuyang911220 2015-1-25 14:50
common   基于FPGA的串口设计(2) yuyang911220 2015-1-25 0/409 yuyang911220 2015-1-25 14:49
common   基于FPGA的串口设计 yuyang911220 2015-1-25 0/407 yuyang911220 2015-1-25 14:48
common   用VERILOG实现门级D触发器和RS触发器 yuyang911220 2015-1-25 0/427 yuyang911220 2015-1-25 14:47
common   Verilog语言中几种不同的触发器描述方式 yuyang911220 2015-1-25 0/398 yuyang911220 2015-1-25 14:46
common   寄存器Verilog yuyang911220 2015-1-25 0/416 yuyang911220 2015-1-25 14:40
common   高速流水线浮点加法器的FPGA实现(2) yuyang911220 2015-1-23 0/569 yuyang911220 2015-1-23 14:49
common   高速流水线浮点加法器的FPGA实现 yuyang911220 2015-1-23 0/485 yuyang911220 2015-1-23 14:48
common   FPGA编程时的一些注意事项(5) yuyang911220 2015-1-23 0/535 yuyang911220 2015-1-23 14:47
common   FPGA编程时的一些注意事项(4) yuyang911220 2015-1-23 0/641 yuyang911220 2015-1-23 14:46
common   FPGA编程时的一些注意事项(3) yuyang911220 2015-1-23 0/384 yuyang911220 2015-1-23 14:45
common   FPGA编程时的一些注意事项(2) yuyang911220 2015-1-23 0/377 yuyang911220 2015-1-23 14:44
common   FPGA编程时的一些注意事项 yuyang911220 2015-1-23 0/386 yuyang911220 2015-1-23 14:43
common   流水线技术在基于FPGA的DSP运算中的应用研究(2) yuyang911220 2015-1-23 0/494 yuyang911220 2015-1-23 14:42
common   流水线技术在基于FPGA的DSP运算中的应用研究 yuyang911220 2015-1-23 0/425 yuyang911220 2015-1-23 14:41
common   基于SystemVerilog语言的验证方法学(9) yuyang911220 2015-1-23 0/528 yuyang911220 2015-1-23 14:40
common   基于SystemVerilog语言的验证方法学(8) yuyang911220 2015-1-23 0/592 yuyang911220 2015-1-23 14:39
common   基于SystemVerilog语言的验证方法学(7) yuyang911220 2015-1-23 0/485 yuyang911220 2015-1-23 14:38
common   基于SystemVerilog语言的验证方法学(6) yuyang911220 2015-1-23 0/386 yuyang911220 2015-1-23 14:37
common   基于SystemVerilog语言的验证方法学(5) yuyang911220 2015-1-23 0/562 yuyang911220 2015-1-23 14:36
common   基于SystemVerilog语言的验证方法学(4) yuyang911220 2015-1-23 0/357 yuyang911220 2015-1-23 14:35
common   基于SystemVerilog语言的验证方法学(3) yuyang911220 2015-1-23 0/401 yuyang911220 2015-1-23 14:35
common   基于SystemVerilog语言的验证方法学(2) yuyang911220 2015-1-23 0/580 yuyang911220 2015-1-23 14:34
common   基于SystemVerilog语言的验证方法学(1) yuyang911220 2015-1-23 0/429 yuyang911220 2015-1-23 14:33
common   Inout双向端口信号处理方法 冰封 2015-1-22 0/385 冰封 2015-1-22 17:19
common   FPGA的基本结构 冰封 2015-1-22 0/399 冰封 2015-1-22 17:18
common   固定逻辑与可编程逻辑PLD的区别 冰封 2015-1-22 0/306 冰封 2015-1-22 17:17
common   FPGA与CPLD的辨别和分类 冰封 2015-1-22 0/320 冰封 2015-1-22 17:16
common   高频电路的电磁兼容设计误区分析 冰封 2015-1-22 0/400 冰封 2015-1-22 17:16
common   verilog hdl输出单个脉冲 冰封 2015-1-22 0/465 冰封 2015-1-22 17:15
common   一种FPGA时钟信号自激产生的方法 冰封 2015-1-22 0/316 冰封 2015-1-22 17:14
common   LabVIEW FPGA和软件设计射频仪器 冰封 2015-1-22 0/373 冰封 2015-1-22 17:13
common   verilog case如果没有default的话 冰封 2015-1-22 0/397 冰封 2015-1-22 17:10
    类型 排序方式 时间范围