首页 | 新闻 | 新品 | 文库 | 方案 | 视频 | 下载 | 商城 | 开发板 | 数据中心 | 座谈新版 | 培训 | 工具 | 博客 | 论坛 | 百科 | GEC | 活动 | 主题月 | 电子展

FPGA/CPLD可编程逻辑

[ 26527 主题 / 25683 回复 ]

版块介绍: 讨论关于FPGA和CPLD的相关话题!

版主: boyfly, stone133, flanix, bydxdtcdj, 电子狂热, xcx_hust, benbenfei, AndyLee008

FPGA/CPLD可编程逻辑

    标题 作者 回复/查看 最后发表
common   时序分析/约束——Xilinx时钟资源 & ISE时序分析器 yuyang911220 2015-8-30 0/613 yuyang911220 2015-8-30 20:54
common   如何仿真ISE中的IP核 yuyang911220 2015-8-30 0/701 yuyang911220 2015-8-30 20:53
common   ISE 14.3与Modelsim 10.1联合仿真前需要处理的问题 yuyang911220 2015-8-30 0/598 yuyang911220 2015-8-30 20:52
common   ISE与ModelSim配置调用及其相关问题解决(2) yuyang911220 2015-8-30 0/556 yuyang911220 2015-8-30 20:52
common   ISE与ModelSim配置调用及其相关问题解决 yuyang911220 2015-8-30 0/536 yuyang911220 2015-8-30 20:51
common   在ModelSim中添加Xilinx仿真库(2) yuyang911220 2015-8-30 0/601 yuyang911220 2015-8-30 20:50
common   在ModelSim中添加Xilinx仿真库 yuyang911220 2015-8-30 0/595 yuyang911220 2015-8-30 20:50
common   如何在Quartus II中调用Modelsim(2) yuyang911220 2015-8-30 0/604 yuyang911220 2015-8-30 20:48
common   如何在Quartus II中调用Modelsim yuyang911220 2015-8-30 0/603 yuyang911220 2015-8-30 20:47
common   modelsim三种仿真实验结果对比(2) yuyang911220 2015-8-30 0/394 yuyang911220 2015-8-30 20:47
common   modelsim三种仿真实验结果对比 yuyang911220 2015-8-30 0/661 yuyang911220 2015-8-30 20:46
common   Modelsim初级使用教程(7) yuyang911220 2015-8-30 0/437 yuyang911220 2015-8-30 20:45
common   Modelsim初级使用教程(6) yuyang911220 2015-8-30 0/573 yuyang911220 2015-8-30 20:44
common   Modelsim初级使用教程(5) yuyang911220 2015-8-30 0/695 yuyang911220 2015-8-30 20:43
common   Modelsim初级使用教程(4) yuyang911220 2015-8-30 0/543 yuyang911220 2015-8-30 20:42
common   Modelsim初级使用教程(3) yuyang911220 2015-8-30 0/534 yuyang911220 2015-8-30 20:42
common   Modelsim初级使用教程(2) yuyang911220 2015-8-30 0/571 yuyang911220 2015-8-30 20:40
common   Modelsim初级使用教程 yuyang911220 2015-8-30 0/540 yuyang911220 2015-8-30 20:39
common   ChipScope Pro核描述 yuyang911220 2015-8-30 0/641 yuyang911220 2015-8-30 20:14
common   使用Chipscope时如何防止reg_wire型信号被优化掉 yuyang911220 2015-8-30 0/759 yuyang911220 2015-8-30 20:13
common   ChipScope Pro Analyzer模块(2) yuyang911220 2015-8-30 0/878 yuyang911220 2015-8-30 20:12
common   ChipScope Pro Analyzer模块 yuyang911220 2015-8-30 0/577 yuyang911220 2015-8-30 20:12
common   FPGA设计开发软件ISE使用技巧之:片上逻辑分析仪(4) yuyang911220 2015-8-30 0/713 yuyang911220 2015-8-30 20:10
common   FPGA设计开发软件ISE使用技巧之:片上逻辑分析仪(3) yuyang911220 2015-8-30 0/706 yuyang911220 2015-8-30 20:09
common   FPGA设计开发软件ISE使用技巧之:片上逻辑分析仪(2) yuyang911220 2015-8-30 0/872 yuyang911220 2015-8-30 20:09
common   FPGA设计开发软件ISE使用技巧之:片上逻辑分析仪 yuyang911220 2015-8-30 0/609 yuyang911220 2015-8-30 20:08
common   基于System ACE的DSP文件系统设计(3) yuyang911220 2015-8-30 0/576 yuyang911220 2015-8-30 20:05
common   基于System ACE的DSP文件系统设计(2) yuyang911220 2015-8-30 0/791 yuyang911220 2015-8-30 20:05
common   基于System ACE的DSP文件系统设计 yuyang911220 2015-8-30 0/646 yuyang911220 2015-8-30 20:04
common   Xilinx FPGA的SelectMAP与BPI配置模式的比较 yuyang911220 2015-8-30 0/540 yuyang911220 2015-8-30 19:49
common   Xilinx FPGA中的CRC模块 yuyang911220 2015-8-30 0/562 yuyang911220 2015-8-30 19:47
common   XILINX V6 CRC使用注意事项 yuyang911220 2015-8-30 0/443 yuyang911220 2015-8-30 19:46
common   漫谈xilinx FPGA 配置电路 yuyang911220 2015-8-30 0/713 yuyang911220 2015-8-30 19:44
common   xilinx部分重配置 yuyang911220 2015-8-30 0/454 yuyang911220 2015-8-30 19:43
common   Verilog有限状态机三段式描述方法(2) yuyang911220 2015-8-30 0/597 yuyang911220 2015-8-30 19:39
common   Verilog有限状态机三段式描述方法 yuyang911220 2015-8-30 0/584 yuyang911220 2015-8-30 19:38
common   Verilog状态机的编写学习(2) yuyang911220 2015-8-30 0/497 yuyang911220 2015-8-30 19:35
common   Verilog状态机的编写学习 yuyang911220 2015-8-30 0/561 yuyang911220 2015-8-30 19:35
common   Verilog基本单元(primitives) yuyang911220 2015-8-30 0/599 yuyang911220 2015-8-30 19:31
common   多任务系统看门狗的实现 苹果也疯狂 2015-8-26 0/729 苹果也疯狂 2015-8-26 11:11
    类型 排序方式 时间范围