首页 | 新闻 | 新品 | 文库 | 方案 | 视频 | 下载 | 商城 | 开发板 | 数据中心 | 座谈新版 | 培训 | 工具 | 博客 | 论坛 | 百科 | GEC | 活动 | 主题月 | 电子展

FPGA/CPLD可编程逻辑

[ 26527 主题 / 25683 回复 ]

版块介绍: 讨论关于FPGA和CPLD的相关话题!

版主: boyfly, stone133, flanix, bydxdtcdj, 电子狂热, xcx_hust, benbenfei, AndyLee008

FPGA/CPLD可编程逻辑

    标题 作者 回复/查看 最后发表
common   FPGA验证问题 babystupid 2007-8-3 1/3269 flanix 2007-12-24 09:41
common   请问quartus中自带有IP核吗 如何使用? xiexiaochuan 2007-10-29 3/3261 caopengly 2007-10-30 11:51
common   [求助]毕业设计:基于CPLD/FPGA的乐曲演奏电路(类似于电子琴的设计) lim520 2006-4-22 9/3253 dadaowai 2007-6-5 19:17
common   Quartus II 为什么不支持Verilog的许多语句? lzjtuwangzhedd 2004-11-11 7/3251 yigaoyang 2004-11-11 20:29
common   PLCC封装可以手工焊么? anotherchen 2006-9-12 11/3251 lygql 2007-1-23 08:39
common   有哪位高手用过Verilog 中inout的,请指点兄弟一把,急啊!救命啊!!! qin 2003-8-23 7/3240 long 2003-8-23 10:30
common   报道贴 chiarwarmer 2008-2-15 0/3235 chiarwarmer 2008-2-15 23:16
common   quartus 2的license该如何安装? qiao_zhi_ 2006-8-5 3/3223 vincent 2006-8-14 15:55
common   Quartus II 9.0 下载地址及license 附件 cjfwindy 2010-4-18 2/3221 cjfwindy 2011-11-22 21:21
common   [下载]verilog HDL RTL书写圣经 bjxiong 2005-11-9 11/3215 lixing865 2011-5-5 21:55
common   设计实例下载:基于FPGA的数字钟设计 ldm1211 2008-6-2 13/3213 zhaoxxgc 2009-5-6 20:25
common   SOC H264视频监控解决方案 davidniu 2010-4-26 1/3211 白红盅 2011-10-15 17:36
common   VHDL设计D触发器,一个很简单的问题,但总是出错 erra168@sina.c 2003-9-1 6/3205 hexuguang 2005-7-21 23:55
common   求助SRAM控制器verilog源代码 xzzjiayou 2009-5-26 2/3197 hzm2008 2009-12-3 18:16
common   cpld的发热问题?! dragontan 2003-10-8 7/3180 dragontan 2003-10-8 17:04
common   状态机的论文,经典!英文原版!PDF格式!  ... 2 outside 2005-10-18 15/3179 fly_dream 2007-12-4 15:59
hot   FPGA设计中的编程技巧 附件  ... 2 bjxiong 2007-11-27 20/3163 yao8177 2008-2-24 20:30
common   北大verilog课件(推荐)  ... 2 vincent 2005-11-9 16/3158 vincent 2005-12-12 11:21
common   ACTEL FPGA Fusion开发板PCB打样入伙邀请! jasonchengjian 2007-7-23 3/3154 yumuzi 2008-8-20 17:02
common   [求助]用什么软件可以把VERILOG的原代码转换为VHDL?? lixunhuan2002 2006-6-1 12/3141 luohongken 2006-8-1 12:22
common   请教一个交通灯VHDL程序的问题。 三刀流的奥义 2004-12-8 6/3140 rainmaker 2005-5-26 01:59
common   vhdl中如何指定延时的多少呢?望大家指导!!!!! ljp 2003-12-12 9/3129 carol.yi@weiken 2003-12-12 14:23
common   伯克利大学数字电路设计powerpoints, let me kow&  ... 2 henryding 2006-4-11 18/3122 jacob_chuang 2007-4-9 23:36
common   Altera疑难问答[转帖] ljp 2004-3-25 4/3118 jianhui0693@163 2004-3-25 00:10
common   请问学习VHDL语言用那本教材最好? momomo 2004-10-10 4/3118 aqulia 2004-10-10 10:57
common   [求助]求fsk 调制解调的vhdl设计原理 winovs 2008-1-23 3/3118 caopengly 2008-1-24 17:27
common   请问,使用Cyclone组件的LVDS,如何配置一对管脚是LVDS输出输入 popeof 2005-10-21 4/3114 flanix 2007-12-19 10:48
common   ModelSim SE 6.0c 只能看到启动封面,不能进入程序? yujunhuihao 2006-4-5 5/3109 binary163 2009-5-13 12:48
common   在ise综合时如何使用block ram zsz810924 2006-4-7 4/3098 zsz810924 2006-4-23 21:25
common   fpga初学:键盘去抖动问题 flying1983 2007-1-4 8/3089 zhangjie5168 2009-4-29 01:00
common   高效状态机编程 附件 oyyg 2008-1-15 14/3078 victor2009 2009-7-3 11:05
common   现在的CPLD在AD转换方面性能如何? simppyx 2003-9-4 10/3069 duxiaoqing@21cn 2003-9-4 17:06
common Icon67 在verilog程序中怎样延迟5个时钟周期 polozpt 2011-3-21 4/3057 eraledit 2011-8-22 15:01
common   [转帖]通广集团与英国SEPURA携手数字集群 tj712 2007-11-2 0/3055 tj712 2007-11-2 10:40
common   如何将Matlab中生成的数据导入到coe文件中 oldjoe 2008-3-17 2/3045 stone133 2008-4-19 16:08
common   [求助]关于EDK开发PowerPC的问题 附件 bitwwj 2008-4-20 10/3042 傲风 2009-2-16 22:27
common   Xilinx Parallel Cable III型 和 IV型的区别! gallopping 2005-6-10 4/3036 shatuoniao 2006-12-9 10:30
common   [求助]请问:CPLD中的全局时钟专用引脚怎么用? pantous 2006-4-4 3/3033 stone2006 2007-5-13 17:55
common   新的ASIC/FPGA设计的digital & analog IP cores可以提供,如需要可email联系 designlab 2007-12-22 0/3031 designlab 2007-12-22 11:16
common   altera公司maxII中UFM的读取小实验 angy670 2006-3-27 4/3022 wangzb186 2006-3-28 17:03
    类型 排序方式 时间范围